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24AA512/24LC512/24FC512
FIGURE 8-2:
RANDOM READ
Bus Activity
Master
S
T
A
R
T
Control
Byte
Address
High Byte
Address
Low Byte
S
T
A
R
T
Control
Byte
Data
Byte
S
T
O
P
SDA Line S 1 01 0 AAA 0
S 1 0 1 0 A A A 1
Bus Activity
x = “don’t care” bit
2 1 0
A
C
K
A
C
K
A
C
K
2 1 0
A
C
K
N
O
A
C
K
P
FIGURE 8-3:
SEQUENTIAL READ
Bus Activity
Master
Control
Byte
Data (n)
Data (n + 1)
Data (n + 2)
Data (n + x )
S
T
O
P
SDA Line
P
Bus Activity
A
C
K
A
C
K
A
C
K
A
C
K
N
O
A
C
K
DS21754M-page 14
? 2010 Microchip Technology Inc.
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